HiPEAC Info 79: Acesso Quântico e IA de Borda Roofline

O documento de hardware mais interessante deste mês não é o lançamento de um chip. É uma edição de revista se comportando como uma bancada de laboratório, com computação quântica de um lado, implantação de IA na borda do outro, e um compilador no meio como aquela pessoa suspeitamente calma segurando o diagrama de fiação. De acordo com o PDF da HiPEAC Info 79, a edição é datada de outubro de 2026 e organiza seu tema de capa em torno da computação quântica, ao mesmo tempo em que destaca Roofline e mixture-of-experts na borda. Essa combinação não é aleatória. É a velha lição de hardware usando duas jaquetas diferentes: cargas de trabalho só se tornam reais quando a pilha oferece a elas um lugar sensato para aterrissar.

O sumário é a desmontagem

De acordo com a HiPEAC Info 79, a edição rotula seu pacote sobre computação quântica como aventuras dos qubits rumo ao software, e inclui o artigo “Estabelecendo as bases para a computação quântica, do hardware ao software e ao acesso.” Essa é a especificação escondida, não porque nomeia um dispositivo mais rápido, mas porque nomeia as camadas que decidem se uma máquina exótica é utilizável fora de uma sala de demonstração. A mesma edição da HiPEAC também lista “Como Roofline está trazendo mixture-of-experts para a borda”, que é uma família de cargas de trabalho bem diferente, mas a rima arquitetural é alta o suficiente para chacoalhar os parafusos do gabinete. As duas histórias são sobre combinar a computação com a máquina real, não com o retângulo brilhante em um slide.

A Roofline diz que seu compilador é baseado em MLIR e traduz modelos de grandes frameworks de IA para formas intermediárias otimizadas para vários backends de hardware. A Roofline também diz que seu SDK se baseia em MLIR e IREE, enquanto o IREE se descreve como um compilador e runtime baseado em MLIR para modelos de aprendizado de máquina que pode mirar sistemas de datacenter, bem como implantações móveis e de borda. O IREE diz que foi projetado para CPUs, GPUs e outros aceleradores, e que oferece suporte a arquiteturas ARM, x86 e RISC-V. Essa é a infraestrutura útil, o tipo de coisa que faz o dispositivo de borda parecer menos uma gaveta de bagunça cheia de adaptadores e mais um trilho de energia com etiquetas que significam alguma coisa.

@title Caminho do compilador de IA na borda
@source Roofline
@source IREE

  AI frameworks
        │
        ▼
  MLIR
        │
        ▼
  IREE
        │
        ▼
  CPUs GPUs accelerators
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        ▼
  ARM x86 RISC-V

@caption Roofline e IREE descrevem um caminho de compilador dos modelos até os alvos de hardware na borda.

Computação quântica é um problema de pilha, não uma caixa mágica

A HiPEAC Info 79 descreve a computação quântica como uma tecnologia com grande potencial disruptivo, mas também deixa claro que o caminho à frente não é simples. Isso importa porque o hardware quântico muitas vezes é discutido como se a contagem de qubits, sozinha, contasse toda a história. Não conta. Um sistema quântico sem software, seleção de cargas de trabalho e acesso é como uma bela frente de RF soldada a uma placa sem conectores: impressionante, cara e, na maior parte, uma peça de conversa.

A inclusão, na edição, de um texto sobre identificar cargas de trabalho apropriadas para computação quântica é a parte que os leitores deveriam sublinhar, de acordo com o PDF da HiPEAC. Nem todo problema merece uma máquina quântica, assim como nem todo modelo embarcado merece um acelerador com um dissipador dramático e um orçamento de energia que consome o produto em silêncio. A pergunta de engenharia é sobre adequação. Se a carga de trabalho não mapeia de forma limpa, o hardware vira teatro, e teatro tem características térmicas terríveis.

A lição de IA na borda da Roofline é realismo de compilador

A Roofline diz que foi fundada em 2024 como um spin-off da RWTH Aachen University, na Alemanha, o que dá ao discurso de compilador da empresa um aroma de arquitetura acadêmica em vez de uma máquina de fumaça puramente de marketing. Seu site diz que a arquitetura pode se adaptar a novos hardwares, especialmente NPUs, e oferece suporte à execução heterogênea em um sistema. Esse é exatamente o tipo de frase que pessoas de hardware não deveriam pular, porque a execução heterogênea é onde diagramas de blocos elegantes vão descobrir se levaram lanches suficientes. CPUs, GPUs, NPUs e pequenos aceleradores estranhos não cooperam automaticamente só porque compartilham um pacote.

O IREE acrescenta o contexto mais amplo. De acordo com o IREE, sua cadeia de ferramentas reduz modelos de aprendizado de máquina a uma representação intermediária unificada e é feita para implantações que vão de datacenters até as restrições de dispositivos móveis e de borda. Isso mostra por que a presença da Roofline na mesma edição que a computação quântica é interessante: os dois temas estão lidando com acesso a computação especializada. Um trata de levar recursos quânticos utilizáveis acima da linha de neblina do hardware, enquanto o outro trata de colocar modelos modernos de IA em máquinas pequenas sem transformar a implantação em uma sessão espírita de portabilidade.

O que os leitores devem observar a seguir

A conclusão prática da HiPEAC Info 79 é ler a cobertura de hardware emergente de trás para frente, começando pela carga de trabalho. Quando a HiPEAC agrupa hardware quântico, software, acesso e identificação de cargas de trabalho na mesma edição, ela está empurrando os leitores para o pensamento sistêmico em vez da adoração de especificações. Quando a Roofline e o IREE falam sobre compilação baseada em MLIR em CPUs, GPUs, aceleradores, ARM, x86 e RISC-V, eles apontam para a mesma realidade a partir do lado da IA na borda. A máquina nunca é apenas o chip. É o chip, o compilador, o runtime, a carga de trabalho e o modelo de acesso, todos tentando não tropeçar no mesmo cabo de energia.

Para quem constrói, o próximo passo é simples: quando uma nova plataforma quântica ou uma nova pilha de IA na borda aparecer, pergunte para qual carga de trabalho ela serve, qual camada traduz essa carga de trabalho e quais alvos de hardware são realmente suportados. Essa pergunta é menos glamourosa do que uma foto do die, e digo isso como alguém que absolutamente emolduraria uma boa foto de die. Mas é a pergunta que separa computação útil de escultura cara. Fique de olho em mapeamentos de carga de trabalho mais concretos, suporte de compiladores e modelos de acesso, porque é aí que essas arquiteturas deixam de ser diagramas promissores e começam a virar ferramentas em torno das quais você pode projetar.